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[求助问答] 隔离光耦ACPL-332J的若干问题

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[LV.5]正式坛友

发表于 2018-9-12 10:07:36 | 显示全部楼层 |阅读模式
20E币
【不懂就问】
下图是332J光耦的引脚说明和内部电路图
问题如下
【1】既然已经有了CATHODE和ANODE这一对开通的信号,为什么还要加上VS和VCC1这一组电源呢?它们这组再下图2中起什么作用?
【2】VEE与VCC2这组电源的作用是把CATHODE和ANODE信号放大吗?在下图2中右上角的达林顿结构,就是起到信号放大作用?
【3】VE怎么理解,图1中说是工模输出电压,也和第【1】问有关
【4】如果方便,希望讲解以下内部结构图的工作流程或者原理
2.jpg    图1
                                                

1.jpg   图2



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1.这个是反向的信号通路,用来传输故障信号 2.准确的说这里是作为开关器件,而不是线性放大,级联可以降低导通电压 3.这个VE从功能图可以看出是作为参考地,并为内部逻辑电路提供回路。而VEE则是与驱动电路相连,这意味着VE和VEE有相同的(COMMON)电压,而VEE流过大的驱动电流,VE流过小的逻辑电路电流 4. a)基本功能,驱动IGBT或MOSFET,由光通路到驱动电路 b)保护功能,欠压保护(UVLO),应该就是个比较器,可以除能驱动电路 c)保 ...

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发表于 2018-9-12 10:07:37 | 显示全部楼层
1.这个是反向的信号通路,用来传输故障信号
2.准确的说这里是作为开关器件,而不是线性放大,级联可以降低导通电压
3.这个VE从功能图可以看出是作为参考地,并为内部逻辑电路提供回路。而VEE则是与驱动电路相连,这意味着VE和VEE有相同的(COMMON)电压,而VEE流过大的驱动电流,VE流过小的逻辑电路电流
4.
a)基本功能,驱动IGBT或MOSFET,由光通路到驱动电路
b)保护功能,欠压保护(UVLO),应该就是个比较器,可以除能驱动电路
c)保护功能,过流保护(desaturation detection),当IGBT电流过大时,CE压降升高,这个电压与内部参考电压比较,若超过则除能驱动电路。
d)特殊功能,active miller clamping,可以防止在关断时(由导通到关断)由于米勒电容充电产生的充电电流在门限流电阻上压降过高,使IGBT意外导通,在关断时至下一次导通前由内部钳位电路将门电压钳位在低于特定电压

简单描述,具体内部电路怎么实现,怎么工作还是自己研究一下吧,还挺有意思的
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 楼主| 发表于 2018-9-12 15:17:28 | 显示全部楼层
aicsyou 发表于 2018-9-12 10:07
1.这个是反向的信号通路,用来传输故障信号
2.准确的说这里是作为开关器件,而不是线性放大,级联可以降低 ...

谢谢,我吧,现在看这种大家都已经常用的器件的datasheet,就是为了把以前拉下的基础搞上去
感觉以前常用的一些器件,现在必须要会了
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发表于 2018-9-12 16:12:49 | 显示全部楼层
shaorc 发表于 2018-9-12 15:17
谢谢,我吧,现在看这种大家都已经常用的器件的datasheet,就是为了把以前拉下的基础搞上去
感觉以前常用 ...

不客气,其实也没有绝对的常用器件,每年都有很多新的IC设计出来并且投产,针对不同的应用。像说到常用的运放、经典的运放741,现在应该很少用了吧,以前大学做实践课提供的运放只有741。如果手头有产品的电路资料可以看看都用了哪些器件,可以作为一个解决方案研究一下以后可以参考。
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 楼主| 发表于 2018-9-12 16:49:21 | 显示全部楼层
aicsyou 发表于 2018-9-12 16:12
不客气,其实也没有绝对的常用器件,每年都有很多新的IC设计出来并且投产,针对不同的应用。像说到常用的 ...

你说的运放740,是和AD7401AYRWZ一个系列吗?
遇到过这个芯片的应用
它的工作原理是这样吗?
先是差分信号从VIN+和-进来,输出信号是CAP-AD-DATA
看datasheet中说信号CAP-AD-CLK是从外部发入的,比如cpld
这就是主要的工作方式了吧?
1.jpg
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发表于 2018-9-12 22:49:17 | 显示全部楼层
不是啊,这应该是一个delta-sigma的模数转换器。。就像你说的外部提供时钟,输出0或1.运放741是个古董级的运算放大器
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 楼主| 发表于 2018-9-13 08:48:54 | 显示全部楼层
本帖最后由 shaorc 于 2018-9-13 09:29 编辑
aicsyou 发表于 2018-9-12 22:49
不是啊,这应该是一个delta-sigma的模数转换器。。就像你说的外部提供时钟,输出0或1.运放741是个古董级的 ...

哦哦,
你说光耦332J的VE是为内部逻辑电路提供回路,但是VE也是这个芯片16个引脚中的一个,既然是内部的地,怎么还要引出来一个引脚,
而且你说VEE与驱动电路相连,就说明VE和VEE有相同的共模电压,但是共模信号是相对于地而言的,既然VE和VEE不是一个地,为什么有相同共模电压?
顺便再问一个
那我正好就问图中的这个AD740芯片吧
图中它的差分信号是从电压250VDC的左右两侧引出的
一路是经过R1-R5的5个几十K的电阻串联分压
另外一路是经过R6-R7两个几十K的电阻串联分压
【1】进入AD7401A的VIN+和-,这是检测电压250VDC的什么啊,过压还是过流?因为已经有采样电阻R1了,所以不知道采样R1后如何操作
【2】我看说明书里,有一个采样电阻,在图里因该是R8吧?
【3】你说外部提供时钟信号AD-CLK,芯片输出AD-DATA是0或者1,那么为什么要通过时钟信号才能有输出
呢,而且输出的数字信号0或1是再返还给外部,比如cpld芯片,来做保护作用?

IMG_20180913_083732_1.jpg
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发表于 2018-9-13 20:04:42 | 显示全部楼层
1.芯片将引脚引出来可能是因为芯片设计的原因,比如说很多模数转换器ic有GNDA和GND,一个是模拟地一个是数字地,一般芯片手册中会简易在布线时将这两个地连起来,这是因为芯片封装时将他们在内部连起来会有很大的阻抗
2.芯片手册中并没有说是共模(common mode)
3a.你的电路图应该有误,发光二极管的负级应该是接地的,采样的是250V电压,R8与那一串电阻分压
3b.如3a
3c.sigma-delta类型的转换器都是这样的,每个时钟信号进行一次比较和积分,比较的结果输出0或1.你可以看看原理

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 楼主| 发表于 2018-9-13 21:50:56 来自手机 | 显示全部楼层
aicsyou 发表于 2018-9-13 20:04
1.芯片将引脚引出来可能是因为芯片设计的原因,比如说很多模数转换器ic有GNDA和GND,一个是模拟地一个是数 ...

谢谢
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 楼主| 发表于 2018-9-15 15:55:36 | 显示全部楼层
aicsyou 发表于 2018-9-12 10:07
1.这个是反向的信号通路,用来传输故障信号
2.准确的说这里是作为开关器件,而不是线性放大,级联可以降低 ...

还是这个系列的问题
一个PWM调制IC SG3525A ,电路作用是让储能的电压升压并放电出去,供电,所以输出boost_pwm信号,控制升压
【1】左边的信号DIS_EN是放电的使能信号,但是配合分压电阻R1和R2是干什么呢?如果让三极管V1导通了,有什么作用,这里的原理不懂
【2】同理,VIN+的输入信号,右上角的V2和分压电阻R5、R6起什么作用呢?
【3】芯片的反向端VIN-的输入信号,右下角的N1和N是直流母线的采样电阻两端,那如图这样的话,U1B这个比较器是在比较什么啊,特别是从N1还迁出了一根地线经过R12到GND
TIM图片20180915155453.jpg

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